聯電與Cadence毫米波參考流程 達成一次完成矽晶設計

蘇嘉維／台北報導

聯電（2303）與全球電子設計創新領導廠商益華電腦（Cadence Design Systems，Inc.）於30日宣布雙方合作經認證的毫米波參考流程，成功協助亞洲射頻IP設計的領導廠商聚睿電子（GearRadio Electronics），在聯電28HPC+製程技術以及Cadence射頻（RF）解決方案的架構下，達成低噪音放大器（LNA）IC一次完成矽晶設計（first-pass silicon success）的非凡成果。

經驗證的聯電28HPC+解決方案非常適合生產應用於高速毫米波設備的晶片，並支援高達110GHz的電路設計應用，例如聚睿電子的低噪音放大器設計，可提供精確的矽製程模型。

Cadence Virtuoso RF解決方案結合了多個電磁（EM）求解器，使聚睿電子能夠獲得精確的矽製程結果。更具體地說，聚睿電子使用了業界黃金標準的電磁模擬器Cadence EMX Planar 3D Solver電磁模擬工具，為CMOS設計建立精準電磁模型，大幅度減少了從電路佈局設計到佈局後模擬驗證所需的設計周期。

與過往的設計流程相較，聚睿電子更快地實現了一次完成矽晶設計並擁有精確的矽製程設計成果。當聚睿電子將模擬結果與其60GHz低噪音放大器的矽製程測量值進行比較時，發現其正向穿透係數（S21，即正向增益）在峰值頻率、峰值和雜訊指數（NF）等指標誤差皆僅落在中段個位數百分比範圍內。

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